标签 > 时钟缓冲器
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CDCV304-EP 通用和 PCI-X 1:4 时钟缓冲器
CDCV304是一款高性能，低偏斜，通用PCI-X兼容型时钟缓冲器。它分配一个输入时钟信号（CLKIN）至输出时钟（1Y [0：3]）。它专为与PCI-X应用一起使用而设计.CDCV304运行在3.3 V和2.5 V电源电压上，因此此器件与3.3-V PCI-X规范兼容。 CDCV304额定运行温度介于-40°C至105°C之间。 特性 通用且PCI-X 1：4时钟缓冲器 运行频率 0 MHz至200 MHz通用 低输出偏斜：＆lt; 100 ps 分配一个时钟输入至一组四个输出 当输出使能引脚（OE）为低电平时，驱动输出的输出使能控制为低电平 由3.3-V或者2.5-V单电源供电运行 < li>符合PCI-X标准 8-引脚薄型小尺寸（TSSOP）封装 参数 与其它产品相比 时钟缓冲器 Additive RMS Jitter (Typ) (fs) Output Frequency (Max) (MHz) Input Level Number of Outputs Output Level VCC (V) VCC Out (V) Input Frequency (Max) (MHz) Operating Temperature Range (C) Package Group Package Size: mm2:W x L (PKG) Rating var link = "zh_CN_folder_p_quick_...
CDC2351-EP 具有三态输出的增强型产品 1 线路至 10 线路时钟驱动器
CDC2351是一款高性能时钟驱动器电路，可将一个输入（A）分配到10个输出（Y），时钟分配的偏差最小。输出使能（OE）\输入禁止输出进入高阻态。每个输出都有一个内部串联阻尼电阻，以改善负载的信号完整性。 CDC2351工作在标称3.3 V V CC 。 传输延迟在出厂时使用P0和P1引脚进行调整。工厂调整可确保零件到零件的偏斜最小化并保持在指定的窗口内。引脚P0和P1不适合客户使用，应连接到GND。 CDC2351M的特点是可在55°C至125°C的整个军用温度范围内工作。 特性 受控基线 一个装配/测试现场，一个制造现场 55°C至125°C的扩展温度性能 增强的减少制造源（DMS）支持 增强产品更改通知 资格谱系 用于时钟分配和时钟的低输出偏移，低脉冲偏移 - 生成应用 在3.3VV CC LVTTL兼容输入和输出下工作 支持混合模式信号操作（具有3.3VV CC的5V输入和输出电压） 将一个时钟输入分配给10个输出 输出具有内部串联阻尼电阻以减少传输线路效果 分布式V CC 和接地引脚降低开关噪声 最先进的EPIC-IIB ?? BiCMOS设计显着降低功耗 收缩小外形（DB）封装 符合JEDEC和行业标准的元件认证，确保在...
CDCVF2310-EP CDCVF2310-EP 2.5V 至 3.3V 高性能时钟缓冲器
CDCVF2310是一款运行频率高达200MHz的高性能，低偏斜时钟缓冲器。五个输出的两个组中的每一个组提供CLK的低偏斜副本。加电后，无论控制引脚的状态如何，输出的缺省状态为低电平。对于正常运行，当控制引脚（分别为1G或2G）被保持在低电平并且在CLK输入上检测到一个负时钟边沿时，组1Y [0：4]或2Y [0：4]的输出可被置于低电平状态。当控制引脚（1G和2G）被保持在高电平并且在CLK输入上检测到一个负时钟边沿时，组1Y [0：4]或2Y [0：4]的输出可被切换至缓冲器模式。此器件运行在一个 2.5V和3.3V环境中。内置的输出使能毛刺脉冲抑制可确保一个已同步的输出使能序列以分配完全周期时钟信号。 CDCVF2310运行温度范围为-55°C至125° C。 特性 高性能1:10时钟驱动器 在V DD 为3.3V时，运行频率高达200MHz 在V DD 为3.3V时，引脚到引脚偏斜小于100ps V DD 范围：2.3V至3.6V 输出使能毛刺脉冲抑制 将一个时钟输入分频至五个输出的两个组 25Ω片载串联阻尼电阻器 采用24引脚薄型小尺寸封装（TSSOP） 参数 与其它产品相比 时钟缓冲器 Additive RMS Jitter (Typ) (fs) Output Fr...
CDCLVP111-EP 具有可选输入的 1:10 LVPECL 缓冲器
CDCLVP111时钟驱动器使用最小的时分偏斜将LVPECL输入的一个差分时钟对（CLK0，CLK1）分频为差分LVPECL时钟（Q0，Q9） CDCLVP111专用设计用于驱动器50Ω传输线路。当一个输出引脚不被使用时，建议将其保持在开状态以减少功耗。如果只使用差分对中的输出引脚中的一个，那么其它输出引脚必须被同样地端接至50Ω。 如果要求单端输入运行，V BB 基准电压输出被使用。在这种情况下，V BB 引脚应该被连接至 CLK0 并由一个10nF电容器旁通至接地（GND）。 然而，要实现高达3.5GHz的高速性能，强烈建议使用差分模式。 CDCLVP111额定工作温度范围是 - 55°C至125°C。 特性 将一个差分时钟输入对LVPECL分配至10个差分LVPECL 与低压发射器耦合逻辑（LVECL）和LVPECL完全兼容 支持2.375V至3.8V的宽电源电压范围 通过CLK_SEL可选择时钟输入 针对时分应用的低输出偏斜（典型值15ps） 额外抖动少于1ps 传播延迟少于355ps 开输入缺省状态 低压差分信令（LVDS），电流模式逻辑（CML），短截线串联端接逻辑（SSTL）输入兼容 针对单端计时的V BB < /sub>基准电压输...
CDCLVP111-SP CDCLVP111-SP 具有可选输入时钟驱动器的低电压 1:10 LVPECL
CDCLVP111-SP时钟驱动器能够以最低时钟分配偏移将LVPECL输入的一对差分时钟（CLK0和CLK1）分配至十对差分LVPECL时钟（Q0和Q9）输出.CDCLVP111-SP可接受两个时钟源传入一个输入多路复用器.CDCLVP111-SP专为驱动50Ω传输线路而设计。当一个输出引脚不被使用时，建议将其保持在开态态以减少功耗。如果只使用差分对中的输出引脚中的一个，那么其它输出引脚必须被同样地端接至50Ω。 如果要求单端输入运行，V BB 基准电压输出被使用。在这种情况下，V BB 引脚应该被连接至 CLK0 并且一个10nF电容器旁通至接地（GND）。 如需实现高速性能，强烈建议采用差分模式。 CDCLVP111-SP的额定工作温度范围为-55°C至125°C。 特性 将一个差分时钟输入对LVPECL分配至10个差分LVPECL 与低压发射器耦合逻辑（LVECL）和LVPECL完全兼容 支持2.375V至3.8V的宽电源电压范围 通过CLK_SEL可选择时钟输入 低输出偏移（典型值为15ps），适用于时钟分配应用 额外抖动少于1ps 传播延迟少于355ps 开输入缺省状态 兼容低压差分信令（LVDS），电流模式逻辑（CML）和短截线...
Microchip推出全新时钟缓冲器 远超PCIe®第五代（Gen 5）防抖标准
随着数据中心向更高的带宽和更高速的基础架构迁移，对更高性能时序器件的需求变的至关重要。Microchip Technology Inc.（美国微芯科技公...
ADI最近发布了一款时钟缓冲器和分频器IC（集成电路）AD9508，该电路结合了高速、极低抖动（12 kHz至20 MHz频段为41 fs）及可选分频功能。
Silicon Laboratories (芯科实验室有限公司, NASDAQ: SLAB)今日宣布推出业界首款通用时钟缓冲器(clock buffer...
Silicon Labs扩展其PCIe时钟发生器和时钟缓冲器产品组合
Silicon Laboratories (芯科实验室有限公司)日前宣布扩展其PCI Express(PCIe)时钟发生器和时钟缓冲器产品组合。
TI新推高集成正弦波时钟缓冲器可显著降低成本，节省板级空间 日前，德州仪器 (TI) 宣布推出业界最小型 4 通道、低功耗、低抖动正弦至正弦波时钟缓冲...
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